cs:adcoctospi
Rozdíly
Zde můžete vidět rozdíly mezi vybranou verzí a aktuální verzí dané stránky.
Obě strany předchozí revizePředchozí verzeNásledující verze | Předchozí verzePoslední revizeObě strany příští revize | ||
cs:adcoctospi [2013/12/23 11:28] – kaklik | cs:adcoctospi [2017/06/14 15:05] – kaklik | ||
---|---|---|---|
Řádek 1: | Řádek 1: | ||
- | ====== | + | ====== |
Rychlý 8mi kanálový analogově digitální převodník. Vstupní konektory jsou diferenciální SATA se řízenou impedancí. | Rychlý 8mi kanálový analogově digitální převodník. Vstupní konektory jsou diferenciální SATA se řízenou impedancí. | ||
Řádek 14: | Řádek 14: | ||
===== Konstrukce modulu ===== | ===== Konstrukce modulu ===== | ||
- | ===== Plán realizace ===== | ||
- | Celá konstrukce " | + | Pro realizaci digitalizačního modulu jsou z analogové stránky konstrukce zvláště výhodné obvody typu Ultrasound AFE. Například [[http:// |
- | " | + | |
- | Důležitými parametry na které je potřeba se při konstrukci zaměřit jsou: | ||
- | * Dynamický rozsah | ||
- | * Fázová stabilita mezi jednotlivými kanály | ||
- | * šum | ||
- | * Vzorkovací jitter. | ||
- | Aktuálně je tento problém řešen na profesionální úrovní proprietárními digitalizačními jednotkami (([[http:// | ||
- | |||
- | ==== Konstrukce funkčního vzoru ==== | ||
- | |||
- | V první fázi bude navrhnut a zkonstruován funkční vzor zařízení. K tomuto účelu bude využita již dostupná vývojová deska s FPGA [[http:// | ||
- | Na tuto vývojovou desku budou navrženy redukční moduly s konektory, které umožní přípojení ADC mimo skříň počítače (neboť v prostředí skříně počítače není možné realizovat analogové obvody bez využití masivních odrušovacích technik). Na tyto přechodové moduly budou umístěny konektory vhodné pro vedení diferenčních signálů kabelem. Je navíc možné, že mezi vývody FPGA a kabelovým konektorem bude muset být umístěn výkonový buďič sběrníce, aby byla zachována dostatečná integrita signálů vedených kabely. | ||
- | |||
- | V ideálním případě by bylo vhodné, aby počet převodníků mohl být různý. A škálovatelný po dvojici kanálů (efektivně jde o škálování na počet přijímačů). | ||
- | |||
- | ==== Výběr ADC ==== | ||
- | |||
- | Na výběru ADC závisí konkrétní formát signálů, který bude veden do FPGA. Formátů, které poskytují dostupné ADC je několik: | ||
- | |||
- | * DDR LVDS | ||
- | * JEDEC 204B | ||
- | * JESD204A | ||
- | * LVDS | ||
- | * Serdes | ||
- | * serial LVDS | ||
- | |||
- | Zatím nejperspektivnější se zdá být použití rozhraní serial LVDS, které potřebuje nejméně differenčních signálových párů, což zjednodušuje konstrukci. | ||
- | |||
- | |||
- | Pro realizaci digitalizačního modulu jsou z analogové stránky konstrukce zvláště výhodné obvody typu Ultrasound AFE. Například [[http:// | ||
| |
cs/adcoctospi.txt · Poslední úprava: 2017/06/14 15:05 (upraveno mimo DokuWiki)